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通用LVDS数据模拟源

时钟与数据相位关系可调,步进1ns

自定义LVDS位宽

LVDS级联功能

设备体积小,携带方便

产品简介

        设备尺寸为:240mm*244mm*49mm(长*宽*高),电源集成在整机中。正面为开关及控制接口,背面为六路用户LVDS接口。主要由FPGA、ARM、以太网PHY、USB PHY、USB Hub、Flash、时钟芯片、DDR芯片、mSATA硬盘等组成。

        设备可实现24路LVDS数据发送,发送数据存放在内置固态硬盘中。可通过多台设备级联实现接口数量扩展。上位机内置数据生成功能,可根据客户要求生成各种帧格式的数据文件。

l   接口类型:LVDS,接口位宽:20-bit(可拆分),时钟速率:100KHz-100MHz可调;时钟相位可调整

l   接口数量:6个数据发送接口,1个自检接收接口

l   每个接口对应一个mSATA固态硬盘存储数据

l   通过USB3.0接口或千兆网口对设备进行控制,设备可级联

l   通过构造数据文件实现正逆程变化的数据发送




产品框架

        设备由1块主板和2块扣板组成,主板上主要由FPGA、以太网PHY、USB PHY、USB Hub、ARM、Flash、PLL`等组成。每块设备对外出6路LVDS输出、1路LVDS输入,为减小设备面积,对外LVDS连接器采用上下两层设计,主板上出3路输出和1路输入,连接器扣板上出3路输出。主板对外出一个千兆网口和2个USB口,2个USB口通过Hub引出,用来实现多个设备级联功能,用户通过千兆以太网或者USB口将发送的数据导入设备,导入的数据存在存储板上的mSATA盘中,每个盘对应1路LVDS,6路LVDS需要6个mSATA盘,为了减少主板面积,3个mSATA盘放在主板上,另外3个放在扣板上。FPGA外挂了大容量DDR3内存条,用于缓存数据。主板上的ARM用于时钟配置、版本升级、命令解析、状态上报等,ARM对外出百兆网口或者USB接口与计算机相连,接收命令、FPGA版本文件、上报状态均通过该接口。系统框图如下图所示:
image.png

产品参数

l   接口类型:LVDS,接口位宽:20-bit(可拆分),时钟速率:100KHz-100MHz可调;时钟相位可调整

l   接口数量:6个数据发送接口,1个自检接收接口

l   每个接口对应一个mSATA固态硬盘存储数据

l   通过USB3.0接口或千兆网口对设备进行控制,设备可级联

l   通过构造数据文件实现正逆程变化的数据发送


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